ADSP21061LKS-160 数字信号处理器 封装QFP240 蓝信伟业
ADSP21061LKS-160 数字信号处理器 封装QFP240 蓝信伟业
ADSP21061LKS-160
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ADSP21061LKS-160  数字信号处理器  封装QFP240   蓝信伟业
 
特征:
●核心架构:超级哈佛架构(SHARC),4 条独立总线,支持双数据读取、指令读取与无干扰 I/O 并行。
●运算性能:
●指令速率:40MHz(25ns 周期),40 MIPS。
●浮点性能:120 MFLOPS 峰值、80 MFLOPS 持续。
●支持 32 位单精度 / 40 位扩展精度 IEEE 浮点、32 位定点格式。
●片上内存:1Mbit(128KB)双端口 SRAM,可配置为 32K×32 位数据或 16K×48 位指令存储
 
说明:
ADSP21061LKS-160 是 ADI SHARC 系列低功耗 3.3V 浮点 DSP,基于超级哈佛架构,单周期完成乘法、ALU 运算及双内存读写,集成大容量片上 SRAM 与丰富外设,无需外部存储即可实现复杂算法,是高性能嵌入式信号处理的经典方案。
 
参数:
●核心:32 位 SHARC 浮点 DSP
●时钟:40MHz
●运算能力:40 MIPS、120 MFLOPS(峰值)
●片上 SRAM:128KB(1Mbit)
●电源:核心 3.3V,I/O 3.3V
●温度:0°C ~ +85°C
 
应用场景:
●通信设备:基站、调制解调器、信道编码 / 解码。
●音频 / 视频处理:专业音频工作站、图像处理、视频编解码。
●工业控制:高精度运动控制、电机驱动、工业机器人。
●医疗设备:超声成像、心电监测、医学影像处理。
●雷达 / 声呐:信号滤波、波束形成、目标检测。
 
ADSP21061LKS-160  数字信号处理器  封装QFP240   蓝信伟业
 
特征:
●核心架构:超级哈佛架构(SHARC),4 条独立总线,支持双数据读取、指令读取与无干扰 I/O 并行。
●运算性能:
●指令速率:40MHz(25ns 周期),40 MIPS。
●浮点性能:120 MFLOPS 峰值、80 MFLOPS 持续。
●支持 32 位单精度 / 40 位扩展精度 IEEE 浮点、32 位定点格式。
●片上内存:1Mbit(128KB)双端口 SRAM,可配置为 32K×32 位数据或 16K×48 位指令存储
 
说明:
ADSP21061LKS-160 是 ADI SHARC 系列低功耗 3.3V 浮点 DSP,基于超级哈佛架构,单周期完成乘法、ALU 运算及双内存读写,集成大容量片上 SRAM 与丰富外设,无需外部存储即可实现复杂算法,是高性能嵌入式信号处理的经典方案。
 
参数:
●核心:32 位 SHARC 浮点 DSP
●时钟:40MHz
●运算能力:40 MIPS、120 MFLOPS(峰值)
●片上 SRAM:128KB(1Mbit)
●电源:核心 3.3V,I/O 3.3V
●温度:0°C ~ +85°C
 
应用场景:
●通信设备:基站、调制解调器、信道编码 / 解码。
●音频 / 视频处理:专业音频工作站、图像处理、视频编解码。
●工业控制:高精度运动控制、电机驱动、工业机器人。
●医疗设备:超声成像、心电监测、医学影像处理。
●雷达 / 声呐:信号滤波、波束形成、目标检测。
 
电话:+86-755-83681378 83291586 83687442
传真:+86-755-83687442
移动电话:13424188068 
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